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  Virtuoso Layout高级培训班(Cadence)
   入学要求

        学员学习本课程应具备下列基础知识:
        ◆ 电路系统的基本概念。

   班级规模及环境
       为了保证培训效果,增加互动环节,我们坚持小班授课,每期报名人数限3到5人,多余人员安排到下一期进行。
   上课时间和地点
上课地点:【上海】:同济大学(沪西)/新城金郡商务楼(11号线白银路站) 【深圳分部】:电影大厦(地铁一号线大剧院站)/深圳大学成教院 【北京分部】:北京中山学院/福鑫大楼 【南京分部】:金港大厦(和燕路) 【武汉分部】:佳源大厦(高新二路) 【成都分部】:领馆区1号(中和大道) 【沈阳分部】:沈阳理工大学/六宅臻品 【郑州分部】:郑州大学/锦华大厦 【石家庄分部】:河北科技大学/瑞景大厦
最近开课时间(周末班/连续班/晚班)
Virtuoso Layout高级培训班:2024年1月8日
   学时
     ◆课时: 共5天,30学时

        ◆外地学员:代理安排食宿(需提前预定)
        ☆注重质量
        ☆边讲边练

        ☆合格学员免费推荐工作

        ☆合格学员免费颁发相关工程师等资格证书,提升您的职业资质

        专注高端培训15年,曙海提供的证书得到本行业的广泛认可,学员的能力
        得到大家的认同,受到用人单位的广泛赞誉。

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   最新优惠
       ◆团体报名优惠措施:两人95折优惠,三人或三人以上9折优惠 。注意:在读学生凭学生证,即使一个人也优惠500元。
   质量保障

        1、培训过程中,如有部分内容理解不透或消化不好,可免费在以后培训班中重听;
        2、培训结束后,培训老师留给学员手机和Email,免费提供半年的技术支持,充分保证培训后出效果;
        3、培训合格学员可享受免费推荐就业机会。 ☆合格学员免费颁发相关工程师等资格证书,提升您的职业资质。专注高端培训13年,曙海提供的证书得到本行业的广泛认可,学员的能力得到大家的认同,受到用人单位的广泛赞誉。

  Virtuoso Layout高级培训班(Cadence)
  课程描述

       Virtuoso是Cadence公司开发的,作为一款经典物理验证工具,操作界面友好、易于使用,可以直接对Cadence 的DFII 数据库中的Layout数据进行DRC检测和LVS验证,不需要将其导出为其他数据格式。其中DRC检测不仅仅是对物理尺寸进行检查,还包括诸如天线效应的检查,各种图形格点的检查等等,LVS验证则是进行版图电路图对照检查。

   课程内容

第一阶段

部分 1

1 Introduction to the Virtuoso Analog Design Environment
2 Schematic Entry
3 Analog Simulation
4 Displaying Simulation Results
5, 关于版图一些基本知识;

部分 2 :?Virtuoso Custom Design Platform 6.14

l?????????IC61 Virtuoso Schematic Editor L/XL presentation, Lei Song;

?????????????????? ? -new features introduction

l?????????IC61 Analog Design Environment L/XL presentation, Lei Song;

?????????????????????-new features introduction

l?????????IC61 Virtuoso Layout Suite L/XL/GXL?presentation,?Amy Zhang;

???????????????????? -new features introduction

???????????????????? -Live demo of?IC61 Virtuoso Layout Suite?L/XL/GXL,Amy Zhang;

l?????????Workshop of Virtuoso Layout Suite XL?.

?

部分 3 :?Virtuoso MMSIM10.1 Overview

l?????????MMSIM10.1 Presentation, Lei Song;

??????????????????-new features introduction

l?????????Workshop of Virtuoso?MMSIM10.1.

部分 4

5 Analyzing Simulation Results
6 Parametric Analysis
7 Using the OCEAN and SKILL Languages
8 Corners Analysis

部分 5
9 Monte Carlo Analysis
10 Component Description Format(CDF)
11 Macromodels, Subcircuits, andInline Subcircuits
12 Hierarchy Editor
13 Inherited Connections

?
??Layout generation
?
??Editing?Virtuoso XL placement
?
??Creating interconnect in Virtuoso?XL

??Using the Wire?Editor
?
??Analyzing and updating data
?
??Working with hierarchical designs and variables

??Generating?abstracts

??Floor planning with Virtuoso?Preview
??Virtuoso Custom Placer setup
??Pin placement with Virtuoso Custom Placer

??Placement?planning and the auto placer

?第二阶段

1, 后端设计关于DRC检测和LVS验证的整个流程;

2, GDS文件和TF库文件的导入;

3, 关于Cadence Virtuoso库文件的配置;

4,DRC检测的规则;

5,版图设计中的一些寄生效应及其消除方法;

6,其他高级布线的技巧与经验总结。

   培养对象

        从事后端设计的版图工程师;希望更深入了解后端设计的工程师;希望从事后端设计有着电路基础知识的大四学生或者硕士研究生

   入学要求

        学员学习本课程应具备下列基础知识:
        ◆ 了解UNIX/LINUX操作系统;
        ◆ 对ASIC设计流程有一定的了解;
        ◆ 了解一些版图的基础知识。

 

节假日、双休日及晚上请垂询招生热线 :4008699035


备 案 号 : 沪 IC P备 08026168 号

.(2014年7月11).......................................................................................................